异构全可编程FPGA芯片

成果、专家、团队、院校、需求、企业在线对接

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高文通与江苏省生产力促进中心高层次人才与外国专家服务处对接成功
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异构全可编程FPGA芯片

需求所属领域：电子信息

需求所处阶段：研制阶段

需求缘由：新产品开发

意向合作方式：技术开发

意向合作院校：

拟投入资金额：面议

参加活动：第二届江苏产学研合作对接大会

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发布人：无锡博士科技离线

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''1、CPU主频不小于667MHz；支持32KB L1 Cache、512KB L2 Cache；支持DEBUG/TRACE接口。 2、CPU外设：DDR2/3、Q-SPI、SD卡、NAND、NOR、三速以太网、CAN 3、FPGA指标：工作频率500MHz、包含DSP、BRAM和时钟管理模块、Serdes≥8Gbps、支持JTAG、主串、从串、主并多种配置模式。 4、FPGA和CPU互联接口：AXI-3/4主、AXI-3/4从、AXI-Lite从、一致性存储接口。 1、CPU主频不小于667MHz；支持32KB L1 Cache、512KB L2 Cache；支持DEBUG/TRACE接口。 2、CPU外设：DDR2/3、Q-SPI、SD卡、NAND、NOR、三速以太网、CAN 3、FPGA指标：工作频率500MHz、包含DSP、BRAM和时钟管理模块、Serdes≥8Gbps、支持JTAG、主串、从串、主并多种配置模式。 4、FPGA和CPU互联接口：AXI-3/4主、AXI-3/4从、AXI-Lite从、一致性存储接口。''

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需求详情

技术介绍

需求简要说明及主要技术参数
''1、CPU主频不小于667MHz；支持32KB L1 Cache、512KB L2 Cache；支持DEBUG/TRACE接口。 2、CPU外设：DDR2/3、Q-SPI、SD卡、NAND、NOR、三速以太网、CAN 3、FPGA指标：工作频率500MHz、包含DSP、BRAM和时钟管理模块、Serdes≥8Gbps、支持JTAG、主串、从串、主并多种配置模式。 4、FPGA和CPU互联接口：AXI-3/4主、AXI-3/4从、AXI-Lite从、一致性存储接口。 1、CPU主频不小于667MHz；支持32KB L1 Cache、512KB L2 Cache；支持DEBUG/TRACE接口。 2、CPU外设：DDR2/3、Q-SPI、SD卡、NAND、NOR、三速以太网、CAN 3、FPGA指标：工作频率500MHz、包含DSP、BRAM和时钟管理模块、Serdes≥8Gbps、支持JTAG、主串、从串、主并多种配置模式。 4、FPGA和CPU互联接口：AXI-3/4主、AXI-3/4从、AXI-Lite从、一致性存储接口。''

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