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16.3Gbps 高速串行接口IP

需求所属领域: 电子信息
需求所处阶段:研制阶段
需求缘由:新产品开发
意向合作方式: 技术开发
意向合作院校:
拟投入资金额: 面议
参加活动: 第二届江苏产学研合作对接大会
发布人:无锡博士科技 离线
''1.支持PCS与PMA功能,PCS与PMA数据接口位宽最高40位; 2.集成4通道,单通道速率范围500Mbps~16.3Gbps; 3.输出抖动小于0.35UI; 4.CML输出驱动,最大差分摆幅950mV; 5. 接收端支持的插损最大25dB; 6.误码率≤10-12; 提出以下几个方面的研究内容: 1.信号完整性电路设计:包括发送端的预加重和去加重电路研究;发送端和接收端的终端阻抗调节电路研究;接收端的自适应均衡器的结构和算法研究。 2.低噪声电路设计:包括多频段低噪声时钟发生器研究;低电源电压稳压器/低频电源噪声过滤器研究;电源网络分布研究。 3.Finfet工艺下模拟/混合信号电路设计:包括高速模拟电路设计研究;LC电感振荡器的设计研究;发送前端和接受前端模拟/混合信号电路结构。 设计一款基于16nm工艺,单通道速率达到16.3Gbps,支持PCIe-gen4,10GBASE-R,OIF-CEI-11G-MR,interlaken12.5及SFP+等通信协议的高速SerDes IP,建立高速SerDes的测试评价方法。''
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需求详情

技术介绍
需求简要说明及主要技术参数
''1.支持PCS与PMA功能,PCS与PMA数据接口位宽最高40位; 2.集成4通道,单通道速率范围500Mbps~16.3Gbps; 3.输出抖动小于0.35UI; 4.CML输出驱动,最大差分摆幅950mV; 5. 接收端支持的插损最大25dB; 6.误码率≤10-12; 提出以下几个方面的研究内容: 1.信号完整性电路设计:包括发送端的预加重和去加重电路研究;发送端和接收端的终端阻抗调节电路研究;接收端的自适应均衡器的结构和算法研究。 2.低噪声电路设计:包括多频段低噪声时钟发生器研究;低电源电压稳压器/低频电源噪声过滤器研究;电源网络分布研究。 3.Finfet工艺下模拟/混合信号电路设计:包括高速模拟电路设计研究;LC电感振荡器的设计研究;发送前端和接受前端模拟/混合信号电路结构。 设计一款基于16nm工艺,单通道速率达到16.3Gbps,支持PCIe-gen4,10GBASE-R,OIF-CEI-11G-MR,interlaken12.5及SFP+等通信协议的高速SerDes IP,建立高速SerDes的测试评价方法。''
企业信息
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所在地区 对接成功后可查看 详细地址 对接成功后可查看
负责人信息
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联系人信息
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